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1 楼 
 文章标题 : 如何修改vim下vhdl语言语法文件(主要是缩进的问题)
帖子发表于 : 2010-03-31 23:35 

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代码:
  " indent:   follow indent of previous opening statement, otherwise -sw
  " keyword:  "begin"
  " where:    anywhere in current line
  if curs =~? s:NC.'\<begin\>'
    let ind = ind - &sw
    " find previous opening statement of
    " keywords: "architecture", "block", "entity", "function", "generate", "procedure", "process"
    let s2 = s:NC.s:NE.'\<\%(architecture\|block\|entity\|function\|generate\|procedure\|process\)\>'
    if (curs !~? s2.'.*'.s:NC.'\<begin\>.*'.s:ES && prevs =~? s2) || m == 1
      let ind = ind + &sw
    endif
    return ind
  endi

这是vhdl语法文件中的一段,它定义了begin下一行的缩进为2个tab位,如何修改使之定义begin下一行的缩进为1个tab位

代码:
architecture rt1 of fenpin3 is
signal p,q:std_logic_vector(1 downto 0);
begin
      process(clk)
      begin
            if(clk'event and clk='1')then
                  if p="10" then
                        p<="00";
                  else
                        p<=p+1;
                  end if;
            end if;
      end process;
      
      process(clk)
      begin
            if(clk'event and clk='0') then
                  if q="10" then
                        q<="00";
                  else
                        q<=q+'1';
                  end if;
            end if;
      end process;
      clk_out<='1' when p="00" or q="00" else
             '0';
end rt1
几乎所有的关键字默认的缩进都是2个tab位


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2 楼 
 文章标题 : Re: 如何修改vim下vhdl语言语法文件(主要是缩进的问题)
帖子发表于 : 2010-04-01 11:17 
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2个TAB不是也还行么 不过不知道如何设置 待达人解答


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